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1. 
Compuertas lógicas que, configurándolas adecuadamente, se puede lograr que realicen funciones de compuertas básicas
A.
AND y OR
B.
NAND y OR
C.
NAND y XOR
D.
Ninguna de las anteriores
2. 
Es una característica de la lógica TTL
A.
Entradas flotantes
B.
Tablas de Verdad
C.
Compuerta básica
D.
Ninguna de las anteriores
3. 
Estructura de salida de algunos circuitos TTL donde se emplea solo un transisto con colector flotante
A.
Salida de emisor abierto
B.
Salida de colector cerrado
C.
Salida de colector abierto
D.
Base cortocircuitada
4. 
Describe la forma en que están conectadosdos transistores bipolares en la salida de la mayor parte de los circuitos TTL
A.
Salida Tótem
B.
Salida de tres estados
C.
Salida de colector abierto
D.
Ninguna de las anteriores
5. 
Son tipos de multivibradores monostables
A.
Reactivables
B.
Reiniciables
C.
De carrera
D.
No reactivables
6. 
Multivibrados que al ser disparadas sus salidas, cambia su estado y permanece fijo por una constante RC de tiempo
A.
Astable
B.
Monostable
C.
Multivibrador
D.
Ninguna de las anteriores
7. 
Fórmulas que nos permiten calcular el período de la señal en el multivibrador astable
A.
T=(0.693Rb*C)+(0.693(Ra+Rb)*C)
B.
T=t1+t2
C.
T=t2/Ciclo de trabajo
D.
T=1/f
8. 
Cuál es la frecuencia de salida y el ciclo de trabajo para un MV astable si C=10Microf, Ra=1.5KOhmios y Rb=70KOhmios
A.
f=1.02 Hz y D=50.53%
B.
f=1.5 Hz y D=75.3%
C.
f=1.1 Hz y D=55.3%
D.
Ninguna de las anteriores
9. 
Los Flip Flop RS, JK, T y D pueden ser de 2 tipos
A.
Activados por Relé y Maestro-esclavo
B.
Set y Reset
C.
Activados por Nivel y Maestro-esclavo
D.
Ninguna de las anteriores
10. 
Flip Flop Toggle
A.
Tipo RS
B.
Tipo JK
C.
Tipo T
D.
Tipo D
11. 
Flip Flop con entrada de reloj
A.
Asíncrono
B.
Temporizador
C.
Síncrono
D.
Ninguna de las anteriores
12. 
Transición con pendiente positiva
A.
Cuando el CLK pasa de 1 a 0
B.
Cuando el CLK está desactivado
C.
Cuando el CLK está habilitado
D.
Ninguna de las anteriores
13. 
Transición con pendiente negativa
A.
Cuando la señal CLK no existe
B.
Cuando el CLK pasa de 0 a 1
C.
Cuando el CLK está habilitado
D.
Ninguna de las anteriores
14. 
Habrá una salida alta en una compuerta NOR cuando
A.
Una de las entradas sea 1
B.
Cuando ambas entradas sean 1
C.
Nunca habrá salida Alta
D.
Cuando ambas entradas sean 0
15. 
Habrá una salida alta en una compuerta NAND cuando
A.
Cuando ambas entradas sean 1
B.
Cuando una de las entradas tenga 1
C.
Nunca habrá salida Alta
D.
Ninguna de las anteriores